Grupo de Ingeniería Microelectrónica

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Departamento de Tecnología Electrónica, Ingeniería de Sistemas y Automática Universidad de Cantabria
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Título:A Framework for the Generation from UML/MARTE Models of IP/XACT HW Platform Descriptions for Multi-Level Performance Estimation
Tipo:Publicacion en Proceedings o Actas internacionales
Lugar:Proceedings of the Forum of Design and Specification Languages 2011 (FDL'2011)
Fecha:2011-09
Autores: Fernando Herrera
Eugenio Villar
Líneas: Diseño y verificación de sistemas embebidos HW/SW
Proyectos: FP7 IP 247999 COMPLEX
ISBN:1636-9874
Fichero:ver fichero
Resumen:Este artículo presenta un marco que automatiza la generación de descripciones IP/XACT de la plataforma HW de un sistema embebido desde un modelo UML/MARTE de dicho sistema. El generador está integrado en un marco de exploración de diseño en el que el sistema completo se especifica en UML, tomando MARTE como perfil de referencia, y en el que se requiere la generación de la información de la plataforma en un formato intermedio, para alimentar a las herramientas a cargo de la generación de modelos ejecutables para la estimación de rendimiento en distingos niveles de abstracción. El marco presentado hace posible la generación de la descripción de la plataforma HW basado en el estándar IP/XACT, de manera que el nivel de información se adapte a las necesidades de los niveles de abstracción manejados por los modelos ejecutables TLM generados (es decir, estimaciones de rendimiento con ejecución nativa de las fuentes y simulaciones basadas en ISS). El generador ha sido completamente integrado en Eclipse, formando parte de un marco de exploración de diseño, y también como un plugin aislado.
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